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modelsim如何手動時序仿真

發布時間:2022-01-06 16:43:46 來源:億速云 閱讀:134 作者:柒染 欄目:互聯網科技

這期內容當中小編將會給大家帶來有關modelsim如何手動時序仿真,文章內容豐富且以專業的角度為大家分析和敘述,閱讀完這篇文章希望大家可以有所收獲。


時序仿真與功能仿真的步驟大體相同,只不過中間需要  添  加仿真庫、網表(.vo)文件和延時(.sdo)文件。  到了這里,問題來了,仿真庫、網表(.vo)文件和延時(.sdo)文件怎么獲得呢?  網表(.vo)文件和延時(.sdo)文件,其實我們在自動仿真的配置仿真功能中已經生成了,當我們配置好仿真功能之后,我們在 Quartus 進行一次全編譯,這時,我們打開 Quartus 工程目錄下 simulation/modelsim 中就能夠看到 Verilog_First.vo 和 Verilog_First_v.sdo 這兩個文件。  我們將這兩個文件復制到我們的 manual_modelsim 文件夾下。  仿真庫,我們需要到我們 Altera的安裝目錄下,也就是 C:\altera\13.1\modelsim_ase\altera\verilog 中找到 cycloneive 文件夾,然后我們將 cycloneive 文件夾也復制到我們的 manual_modelsim 文件夾下。  萬事具備,接下來我們就可以打開我們的 ModelSim 軟件,如圖  
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通過該圖,我們可以看出,這個工程是我們之前做功能仿真的工程,當我們關閉 ModelSim之后,我們再次打開 ModelSim 這個軟件,它會自動記錄上一個我們使用的工程并打開。我們就直接在這個工程上進行更改,首先我們右鍵在彈出的菜單欄中找到【Add to Project】→【Existing File...】按鈕并點擊打開,則彈出圖  
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 在該對話框中我們點擊【Browse】,在彈出的對話框中我們找到 manual_modelsim 文件夾下的 Verilog_First.vo,然后將 Verilog_First.vo 添加至我們的 ModelSim 仿真工程中。接下來我們進行代碼全編譯,編譯完成后,我們在 ModelSim 的菜單欄中找到【Simulate】→【StartSimulation...】按鈕并點擊打開,我們打開 Libraries 標簽,將仿真庫添加至配置仿真環境中,如圖 
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這里我們需要注意的是,只添加一個 cycloneive 仿真庫是不夠的,我們還需要將我們ModeSim 仿真庫中的 altera_ver 庫添加進來,如圖
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 如果不知道需要選擇哪個庫,我們可以先直接運行仿真,這時候 ModelSim 控制窗口中會提示錯誤信息,我們根據錯誤信息便能夠分析出我們需要的庫名,然后我們再重復上述步驟添加完了仿真庫,接下來我們在 SDF 標簽頁面中添加 Verilog_First_v.sdo 文件,如圖
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這里需要我們注意的是,因為的我們的實例化名是 i1,所以我們填寫的是/i1。添加完成之后,最后我們在返回 Design 標簽頁面中,找到 work 下的 Verilog_First_vlg_tst,如圖 
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 在該頁面中,我們點擊【OK】就可以開始進行時序仿真了。

上述就是小編為大家分享的modelsim如何手動時序仿真了,如果剛好有類似的疑惑,不妨參照上述分析進行理解。如果想知道更多相關知識,歡迎關注億速云行業資訊頻道。

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